题目
42.(15分)一个长度为L(L>1)的升序序列 S,处在第|L/2个位置的数称为S的中位数。例如,若序万S1=(11。13,15。17,19)。则S1的中位数是15。两个序的中位数是含它们所有元素的升序序列的中位数。例如,若S2=(2,4,6,8,20),则S1和 S2的中位数是 11。现有两个等长的升序序列 A 和 B,试设计个在时间和空间两方向都尽可能高效的算法,找出两个序列A和B的中位数。要求∶
(1)给出算法的基本设计思想。
(2)根据设计思想,采用C或C++或 Java语言描述算法,关键之处给出注释。(3)说明你所设计算法的时间复杂度和空间复杂度。
(1)算法的基本设计思想如下。
分别求出序列A和B的中位数,设为a和b,求序列A和B的中位数过程如下∶
1)若 a=b,则 a或b 即为所求中位数,算法结束。
2)若ab,则舍弃序列A中较小的一半,同时舍弃序列B中较大的一半,要求舍弃的长度相等;
3)若 a>b,则舍弃序列A中较大的一半,同时舍弃序列B中较小的一半,要求舍弃的长度相等;
在保留的两个升序序列中,重复过程 1)、2)、3),直到两个序列中只含一个元素时为止,较小者即为所求的中位数。
(2)算法的实现如下∶
int M Search (int A[],int B[],int n){
int sl=0,dl=n-1,ml,s2=1,d2=n-1,m2;
//分别表示序列 A 和 B 的首位数、末位数和中位数
while(s1!=dl||s2!=d2){
ml=(sl+d1)/2;
m2=(s2+d2)/2;
if(A[m1] ==B[m2])
return A[ml]; //满足条件1)
if(A[m1]if((s1+d1)%2==0){ //若元素个数为奇数
s1=ml; //舍弃 A中间点以前的部分且保留中间点
d2=m2; //舍弃 B中间点以后的部分且保留中间点
}
else{ //元素个数为偶数
s1=ml+1; //舍弃A中间点及中间点以前部分
d2=m2; //舍弃B中间点以后部分且保留中间点
}
}
else{ //满足条件 3)
if((s1+d1)%2==0){//若元素个数为奇数
d1=m1; //舍弃 A中间点以后的部分且保留中间点
s2=m2; //舍弃B中间点以前的部分且保留中间点力
}
else{ //元素个数为偶数
d1=ml+1; //舍弃A中间点以后部分且保留中间点
s2=m2; //舍弃B中间点及中间点以前部分
}
}
}
return A[s1](3)算法的时间复杂度为0(log2n)),空间复杂度为0(1)。

多做几道

41.(10 分)带权图(权值非负,表示边连接的两顶点间的距离)的最短路径问题是找出从初始顶点到目标顶点之间的一条最短路径。假设从初始顶点到目标顶点之间存在路径,现有一种解决该问题的方法∶
①设最短路径初始时仅包含初始顶点,令当前顶点u为初始顶点;
② 选择离u最近且尚未在最短路径中的一个顶点v,加入最短路径中,修改当前顶点u=v;
③ 重复步骤②,直到u是目标顶点时为止。
请问上述方法能否求得最短路径?若该方法可行,请证明之;否则,请举例说明。
42. (5分)已知一个带有表头结点的单链表,结点结构为
Data/link
假设该链表只给出了头指针 list。在不改变链表的前提下,请设计一个尽可能高效的算法;查找链表中倒数第k个位置上的结点(k为正整数)。若查找成功,算法输出该结点的 data 域的值,并返回1∶否则,只返回0。要求∶
1)描述算法的基本设计思想。
2)描述算法的详细实现步骤。
3)根据设计思想和实现步骤,采用程序设计语言描述算法(使用C、C++或 Java 语言实现),关键之处请给出简要注释。
43.(8分)某计算机的CPU主频为 500Mz,CPI为5(即执行每条指令平均需5个时钟周期)。假定某外设的数据传输率为 0.5MB/s,采用中断方式与主机进行数据传送,以 32 位为传输单位,对应的中断服务程序包含 18条指令,中断服务的其他开销相当于2条指令的执行时间。请回答下列问题,要求给出计算过程。
1)在中断方式下,CPU用于该外设I/O的时间占整个CPU时间的百分比是多少?
2)当该外设的数据传输率达到5MB/s 时,改用DMA 方式传送数据。假定每次 DMA传送块大小为 5000B,且DMA预处理和后处理的总开销为 500个时钟周期,则 CPU用于该外设 I/O 的时间占整个 CPU时间的百分比是多少(假设 DMA与CPU 之间没有访存冲突)?
44.(13 分)某计算机字长为16位,采用16位定长指令字结构,部分数据通路结构如下图所示,图中所有控制信号为1时表示有效、为 0时表示无效。例如,控制信号MDRinE 为1表示允许数据从 DB打入 MDR,MDRin为1表示允许数据从内总线打入 MDR。假设 MAR 的输出一直处于使能状态。加法指令"ADD(R1),RO"的功能为(RO)+(R1))→(R1),即将R0中的数据与 R1的内容所指主存单元的数据相加,并将结果送入 R1的内容所指主存单元中保存。
下表给出了上述指令取指和译码阶段每个节拍(时钟周期)的功能和有效控制信号。请按表中描述方式用表格列出指令执行阶段每个节拍的功能和有效控制信号。
时钟:功能/有效控制信号
C1:MAR←(PC)/PCout, MARin
C2:MDR←M(MDR) PC←(PC)+1/MemR, MDRinE, PC+1
C3:IR←(MDR)/MDRout, IRin
C4:指令译码/无
45.(7分)三个进程P1、P2、P3互斥使用一个包含N(N>0)个单元的缓冲区。
P1每次用 produce()生成一个正整数并用 putO)送入缓冲区某一空单元中;P2每次用 getodd()从该缓冲区中取出一个奇数并用countodd()统计奇数个数;P3每次用 geteven()从该缓冲区中取出一个偶数并用 counteven()统计偶数个数。请用信号量机制实现这三个进程的同步与互斥活动,并说明所定义信号量的含义(要求用伪代码描述)。

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